์ปดํ“จํ„ฐ ๊ตฌ์กฐ(Architecture) ์ค‘๊ฐ„๊ณ ์‚ฌ ๋ฒ”์œ„ ์ ๊ฒ€ ํ€ด์ฆˆ

์ •๋‹ต์€ ์ ‘์€๊ธ€ ํ˜•ํƒœ๋กœ ์ œ๊ณต๋ฉ๋‹ˆ๋‹ค. ์ •๋‹ต์„ ์•Œ๊ณ  ์‹ถ๋‹ค๋ฉด, ๋”๋ณด๊ธฐ๋ฅผ ๋ˆŒ๋Ÿฌ์ฃผ์‹œ๋ฉด ๋ฉ๋‹ˆ๋‹ค. ํ˜น์‹œ ์ œ๊ฐ€ ์ ์€ ๋‹ต ์ค‘ ์˜ค๋ฅ˜๊ฐ€ ์žˆ์–ด๋‚˜ ์„ค๋ช…์ด ๋ถ€์กฑํ•œ ๋ถ€๋ถ„์— ๋Œ€ํ•ด์„œ๋Š” ์ง€์ ํ•ด์ฃผ์‹œ๋ฉด ๊ฐ์‚ฌํ•˜๊ฒ ์Šต๋‹ˆ๋‹ค. 1. Control Dependence์—๋Š” ํ•ญ์ƒ Data Depedence๋งŒ ์กด์žฌํ•œ๋‹ค? ๋”๋ณด๊ธฐ YES! Data Dependence๋Š” ๊ณง RAW ์ƒํ™ฉ์„ ๋งํ•ฉ๋‹ˆ๋‹ค. ๊ทธ๋ฆฌ๊ณ  ์šฐ๋ฆฌ๊ฐ€ PC์— ์ ‘๊ทผํ•  ๋•Œ ์šฐ๋ฆฌ๋Š” ํ•ญ์ƒ RAW๋ฅผ ๊ฒฝํ—˜ํ•˜์ฃ . ๊ทธ๋ž˜์„œ PC์— ๋Œ€ํ•œ Dependency์ธ Control Depedence๋Š” ํ•ญ์ƒ Data Dependence์ž…๋‹ˆ๋‹ค. 2. Code Scheduling์€ (1) Static hazard resolution์ด๋‹ค. (2) Dynamic hazard resolution์ด๋‹ค. ๋”๋ณด๊ธฐ (1) Static hazar..

[JS] ์ฝ˜์†”๋กœ ๊ฐ’ ์ž…๋ ฅ ๋ฐ›๊ธฐ, readline ๋ชจ๋“ˆ

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[์ปดํ“จํ„ฐ๊ตฌ์กฐ] ๋ฌด์ž‘์œ„ ๋ฒ”์œ„ ํ€ด์ฆˆ

1. Coherent๋Š” serialize์— ๋Œ€ํ•ด ์–ด๋–ป๊ฒŒ ์ •์˜ํ•˜๋Š”๊ฐ€? ๋”๋ณด๊ธฐ program order์— ๋งž์ถฐ์„œ serialize๋œ๋‹ค. = ํ”„๋กœ์„ธ์„œ A๊ฐ€ ๋ฉ”๋ชจ๋ฆฌ์— ์ž‘์—…ํ•œ ์ˆœ์„œ๋ฅผ ํ”„๋กœ์„ธ์„œ B๋„ ๊ทธ๋Œ€๋กœ ๋Š๋‚€๋‹ค๋Š” ๋ง. 2. program order์— ๋Œ€ํ•ด ์ข€๋” formalํ•˜๊ฒŒ ๋งํ•ด๋ณด์ž๋ฉด? ๋”๋ณด๊ธฐ program text๋‚˜ assembly code์— ๊ธฐ์ˆ ๋œ ์ˆœ์„œ๋ฅผ ๋งํ•จ. 3. memory consistency model์ด ๋งํ•˜๋Š” ํ•ต์‹ฌ = ๊ฐ load ์—ฐ์‚ฐ์€ ์–ด๋–ค store ์—ฐ์‚ฐ์— ์˜ํ•ด ๊ทธ ๊ฐ’์„ ๋ฆฌํ„ด๋ฐ›๊ฒŒ ๋˜๋Š”๊ฐ€? 4. Seqeuntial Consistency์˜ ํ•œ๊ณ„์ ์„ ๊ธฐ์ˆ ํ•˜๊ณ , ๊ทธ๊ฒƒ์„ ์–ด๋–ป๊ฒŒ ํ•ด๊ฒฐํ–ˆ๋Š”์ง€ ์ œ์‹œํ•ด๋ณด๋ผ. ๋”๋ณด๊ธฐ ํ•œ๋ฒˆ์— ํ•˜๋‚˜์˜ processor๋งŒ ๋ฉ”๋ชจ๋ฆฌ์— ์ ‘๊ทผํ•  ์ˆ˜ ์žˆ๋‹ค. 5. Sequential Consi..

๊ณต์ง€์‚ฌํ•ญ
์ตœ๊ทผ์— ์˜ฌ๋ผ์˜จ ๊ธ€
์ตœ๊ทผ์— ๋‹ฌ๋ฆฐ ๋Œ“๊ธ€
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